TDC 性能指标与误差分析

TDC（时间数字转换器）的性能指标体系与 ADC 既有共通之处（DNL/INL/ENOB/FoM），也有 TDC 特有的概念（SSP 单次精度、PVT 三组件分析）。本章基于 Henzler《Time-to-Digital Converters》Ch.3 系统化梳理。

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前后关系

前置知识：

• TDC架构统一框架与VernierΣΔ方法 — TDC 架构分类
• 数字CMOS PLL架构与TDC-DCO设计 — TDC 基本概念

外部关联：

• 数据转换器基础 — ADC/DAC 性能指标体系对照
• IC电磁兼容基础与耦合机制 — PVT 变化来源
• 纳米CMOS空间不可靠性与工艺变异 — 局部变化建模

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基本原理

1. TDC 基本量化特性

TDC 将时间间隔 $T_{\text{in}}$ 转换为数字输出，其量化特征方程为：

$$T_{\text{in}}=B_{\text{out}}\cdot T_{\text{LSB}}+\epsilon ,0\le \epsilon <T_{\text{LSB}}\text{\hspace{1em}(3.1)}$$

其中 $T_{\text{LSB}}$ 是最小可分辨时间间隔（分辨率），$\epsilon$ 为量化误差。

核心分辨率定义：

$$T_{\text{LSB}}=\frac{T_{\text{ref}}}{2^{N_c}}\text{\hspace{1em}(3.4)}$$

• $N_c$ = 核心分辨率（core resolution，延迟链级数决定）
• $N$ = 总体分辨率（含循环计数器扩展）

2. TDC vs ADC 量化差异

Aspect	ADC	TDC
参考源	外部参考电压 $V_{\text{ref}}$	延迟链自然定义的 $T_{\text{LSB}}$（无外部时间基准）
步进位置	步进位于量化区间中点	步进位于量化区间边界
增益定义	$k_{\text{ADC}}=2^N/V_{\text{ref}}$	$k_{\text{TDC}}=1/T_{\text{LSB}}$

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静态线性误差

3.1 偏移误差（Offset Error）

$$E_{\text{offset}}=T_{\mathrm{00...01}}-T_{\text{LSB}}$$

第一个码步进位置偏离理想值的量。物理根源：信号路径中缓冲树、比较器延迟引入的额外延迟。

3.2 增益误差（Gain Error）

TDC 增益定义为传递函数斜率：

$$k_{\text{TDC}}=\frac{\partial B_{\text{out}}}{\partial T_{\text{in}}}$$

理想增益 $k_{\text{TDC,ideal}}=1/T_{\text{LSB}}$。增益误差为相对偏差：

$$E_{\text{gain}}=1-\frac{k_{\text{TDC}}}{k_{\text{TDC,ideal}}}$$

3.3 微分非线性（DNL）

$$DN{L}_n=\frac{t_{n+1}-t_n-T_{\text{LSB}}}{T_{\text{LSB}}}$$

第 $n$ 级步进宽度偏离理想 $T_{\text{LSB}}$ 的归一化度量。$DNL>1$ LSB 可能导致漏码（missing code）。

3.4 积分非线性（INL）

步进位置相对于理想传递函数的累积偏移：

$$IN{L}_n=\frac{1}{T_{\text{LSB}}}\left(t_{n+1}-t_1-n\cdot T_{\text{LSB}}\right)$$

消除增益误差的 INL（最佳拟合线校正）：

$$IN{L}_n=\frac{1}{T_{\text{LSB}}}\left(t_{n+1}-t_1-(n-1)\cdot \frac{t_N-t_1}{N-1}\right)$$

其中最佳拟合线 $t_n=t_1+\frac{n-1}{N-1}(t_N-t_1)$。

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动态性能指标

4.1 单次精度（Single-Shot Precision, SSP）

TDC 特有的核心动态指标。描述单次测量中的时间不确定度：

$$\text{SSP}=\text{std}({\epsilon }_T)\approx \frac{T_{\text{LSB}}}{\sqrt{12}}(\text{理想量化噪声})$$

此即量化噪声的标准差。在理想情况下 $\text{SSP}=T_{\text{LSB}}/\sqrt{12}$。

4.2 TDC 有效位数（ENOB）

TDC 的 ENOB 定义需要考虑动态范围与分辨率降级：

$$ENO{B}_{\text{TDC}}={\log }_2\left(\frac{DR}{T_{\text{LSB}}\cdot RDC}\right)=M-{\log }_2(RDC)$$

其中 $RDC$（Resolution Degradation Coefficient）为分辨率降级系数：

$$RDC=\frac{{\text{SSP}}_{\text{real}}}{{\text{SSP}}_{\text{ideal}}}=\frac{\text{std}(\epsilon )}{\text{std}({\epsilon }_{\text{ideal}})}$$

4.3 品质因数（FoM）

TDC 的两种基本 FoM 定义：

$$Fo{M}_P=\frac{⟨P⟩}{f\cdot 2^{ENOB}},Fo{M}_A=\frac{⟨A⟩}{f\cdot 2^{ENOB}}$$

• $⟨P⟩$：平均功耗（W）
• $⟨A⟩$：芯片面积（mm²）
• $f$：测量速率（conversions/s）

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量化误差与噪声整形

5.1 开环量化误差

理想情况下量化误差 $\epsilon$ 在 $(0,T_{\text{LSB}}]$ 均匀分布，功率谱密度为白噪声。但当输入缓慢变化时，量化误差与输入相关，产生谐波失真。

5.2 闭环噪声整形

当 TDC 位于反馈环路中（如 DPLL 的路径中），量化噪声可被整形：

• 噪声传递函数 NTF 在低频区域压低量化噪声
• 开环 SSP 由延迟线结构直接决定
• 闭环中 SSP 可通过 NTF 在关注频带内降低
• 等效于过采样 + 噪声整形的 SQNR 提升

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PVT 变化影响

6.1 缓冲树局部变化

Stop 信号缓冲树使各比较器的停止信号产生随机偏斜：

$$t_s=T+\Sigma {\epsilon }_i,\text{其中 }{\epsilon }_i\text{ 为各缓冲器延迟变化}$$ $$\text{SSP 退化}:\text{std}(t_n)=\text{std}(\Sigma {\epsilon }_i)$$

6.2 延迟链局部变化

每级实际延迟含随机变量：

$$t_n=n\cdot T_{\text{LSB}}+\Sigma {\epsilon }_i$$

PVT 下的 DNL：

$$DN{L}_n=\frac{t_{n+1}-t_n-T_{\text{LSB}}}{T_{\text{LSB}}}=\frac{{\epsilon }_{n+1}+{\beta }_{n+1}-{\beta }_n}{T_{\text{LSB}}}$$

其中 ${\beta }_n$ 为比较器偏移变化。

PVT 下的 INL：

$$IN{L}_N=\frac{1}{T_{\text{LSB}}}\left(\sum _{i=1}^N{\epsilon }_i+{\beta }_N-{\beta }_1\right)$$

INL 随延迟链级数增加而累积（随机游走行为）。

6.3 组合影响（噪声 + 变化）

当存在加性噪声时，停止信号到达时间 $t_s=T+\tau$，其中 $\tau \sim \mathcal{N}(0,{\sigma }_{\tau })$。综合考虑后：

$$\text{std}({\epsilon }_T)=\sqrt{\frac{T_{\text{LSB}}^2}{12}+{\sigma }_{\tau }^2+{\sigma }_{\text{delay}}^2}$$

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时序指标

指标	定义	意义
转换时间 $T_{\text{conv}}$	从允许测量到数字输出有效	决定吞吐量
死区时间 $T_{\text{dead}}$	两次测量间的最短间隔	决定采样率上限
延迟时间 $T_{\text{latency}}$	实测完成到输出可用	影响反馈环路延迟

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核心结论

1. SSP 是 TDC 最独特的动态指标，反映了单次测量的时间不确定度，理想情况下为 $T_{\text{LSB}}/\sqrt{12}$
2. DNL/INL 定义与 ADC 类似，但 INL 在延迟链中呈现随机游走累积特性
3. PVT 三组件分析揭示了 TDC 性能退化的物理根源——缓冲树偏斜、延迟链随机变化、加性噪声
4. RDC 系数将实际 SSP 与理想值比较，是连接工艺变化与系统级 ENOB 的关键桥梁
5. 噪声整形可闭环实现：当 TDC 在反馈环路中工作时，可通过 NTF 等效压低带内量化噪声

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参考

• Henzler Time-to-Digital Converters 深度解析 — 来源页，Ch.3
• TDC架构统一框架与VernierΣΔ方法 — TDC 架构分类
• 数字CMOS PLL架构与TDC-DCO设计 — DPLL 中 TDC 的量化噪声传播
• 数据转换器基础 — ADC/DAC 性能指标对照