数字采样锁相环

Gardner Ch.13 系统论述数字化 PLL 的实际构造：数字控制振荡器（DCO）的两种实现路线、混合信号鉴相、载波恢复 DPLL、多速率采样环路，以及量化效应如何从根本上破坏线性（加性）模型——并给出 IPM（增量相位调制器）这一量化噪声整形方案。基于 Gardner Phaselock Techniques Ch.13 + App.13A 提炼。

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前后关系

前置知识：

• 数字PLL传递函数与稳定性 — DPLL 的基本 z-域分析（Ch.4）
• PLL鉴相器 — PD 类型与 s 曲线
• 环路滤波器与电荷泵PLL — CP-PLL 的采样性质

本书内部链条：

• Ch.13（本文）← Ch.4（DPLL 基础）— 深入数字 PLL 的振荡器/量化细节
• → PLL频率合成器（Ch.15）— 全数字合成器使用 DCO/IPM
• → PLL异常锁定现象（Ch.14）— 量化极限环是异常锁定的来源之一

外部关联：

• Wireline系统中Jitter与CDR — 数字 CDR 中的采样 PLL
• Jitter数值方法与Matlab仿真 — NCO 相位累加器的数值实现

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原理介绍

1. 数字控制振荡器（DCO）

数字 PLL 中的振荡器由数字控制字驱动，Gardner 给出两条主要实现路线：

周期型 DCO（period DCO）（Gardner (13.1)/(13.2)）

控制字直接设定振荡周期（延迟单元级数或电流偏置）：

$$f_{out}=\frac{1}{T_{unit}\cdot N_{ctrl}}$$

• 频率分辨率为周期分辨率的倒数映射，频率步长在低频段粗、高频段细（非线性）
• 增益 $K_{DCO}$ 随控制字变化 → 环路参数漂移，需数字校准或增益归一化

相位选择型 DCO（phase-selector DCO）（Gardner (13.3)/(13.5)）

从一组等间隔相位中数字选择输出（如多相环形振荡器/多相分频输出）：

$${\theta }_{out}=\frac{2\pi }{M}\cdot k,k=0,1,\dots ,M-1$$

• 相位步长固定为 $2\pi /M$，相位调制线性度好
• 适合增量相位调制（见下文 IPM）
• 频率由相位步进速率决定，天然适合全数字实现

复数 PD 与 DCO 的组合（Gardner (13.6)）

I/Q 两路复数 PD 输出 $\arg (I+jQ)$ 直接驱动 DCO，s 曲线在 2π 全域单调，适合全数字载波恢复环。

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2. 载波恢复 DPLL（Gardner §13.2）

从已调信号中恢复载波的数字环（Costas 环、判决导向环的数字实现）：

• 调制剥离：判决导向环用判决结果消除数据调制，露出载波相位误差
• BPSK/QPSK 的 M 次方环数字实现：符号率采样后在 DSP 中完成非线性运算
• 环路带宽须远小于符号率，但需大于载波频偏漂移速率

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3. 多速率与混合采样结构（Gardner §13.3）

实际 DPLL 常混合多个采样率：

• A&D（Accumulate & Dump，累加-转存）：高速 PD 输出在一个比较周期内累加后转存给低速环路滤波——等效降采样并提高 PD 增益
• hold（保持）：控制字在比较周期间保持 → 零阶保持延迟
• 总延迟 D（采样数）= PD 延迟 + 滤波延迟 + 保持延迟，直接压缩稳定裕度（见 数字PLL传递函数与稳定性 的 ${\kappa }_2<1/D$ 边界）

App.13A 多速率传递函数（Gardner (13A.20)）

Gardner App.13A 严格推导含 A&D 与多级延迟的闭环传递函数 $G(z)$：

$$\text{特征方程阶数}=2L+D-1$$

（$L$ 为积分器个数，$D$ 为总延迟采样数）——多速率结构的稳定性必须按完整阶数逐点检验，连续近似在高速环中失效。

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4. 量化效应：加性模型失效（Gardner §13.4）

核心结论：细量化时量化误差可近似为加性白噪声；但当量化步长与环路变量可比时，加性模型完全失效，出现确定性非线性行为。

极限环（limit cycle）（Gardner (13.10)）

一阶量化环中，控制字只能取离散值 ${\mu }_i=2^{b_{fits}}$ 个（$b_{fits}$ 为有效位数），相位误差无法收敛到零而在相邻量化电平间周期摆动：

$$\text{极限环幅度}\propto \frac{1}{2^{b_{fits}}}$$

静态相位偏移（Gardner (13.11)/(13.12)）

延迟与量化联合作用产生系统性静态相偏：

$${\theta }_{bias}=\frac{2\pi (D+L-1)}{2^b}$$

（$D$ 总延迟、$L$ 积分器数、$b$ 控制字位数）——位数不足时该偏偏可能占锁定窗口的可观比例。

控制电压量化噪声（Gardner (13.16)）

一阶环中控制字量化引入的均方抖动：

$${\sigma }_{v1}=\frac{1}{2^b{\kappa }_1\sqrt{L}}$$

Gardner 的量化设计规则

1. 控制字位数 $b$ 足够大，使 $2^{-b}$ 远小于允许相偏
2. 用 ΔΣ 调制对控制字做噪声整形（→ IPM）
3. 避免在量化步长与环路自然步长相当的参数点工作（极限环高发区）
4. 仿真必须用非线性差分方程，线性模型无法预测极限环

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5. IPM：增量相位调制器（Gardner §13.5）

IPM（Incremental Phase Modulator）是 Gardner 提出的数字量化噪声整形结构，思想与 ΔΣ 调制器同构：

结构（Gardner (13.26)/(13.27)）

• 相位增量控制字经 $L$ 级累加（积分）后截断为相位选择 DCO 的索引
• 截断误差反馈到输入端（误差反馈=噪声整形）
• 量化噪声被推向高频，带内相位噪声按 $2L$ 阶滚降

噪声整形传递函数（Gardner (13.32)）

$$\text{NTF}(z)=(1-z^{-1}{)}^L$$

$L=1$ 一阶整形（6 dB/oct×2），$L\ge 2$ 高阶整形需稳定性设计（与高阶 ΔΣ 相同的多比特/多级权衡）。

与分数-N 合成的联系

IPM 本质上就是作用于相位路径的 ΔΣ 调制器：分数-N PLL 用 ΔΣ 整形分频比量化噪声，IPM 用同构机制整形 DCO 相位量化噪声——全数字合成器（ADPLL）的核心模块。

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参考文献

1. Gardner, F. M. (2005). Phaselock Techniques (3rd ed.), Ch.13 + App.13A. John Wiley & Sons.
2. Meyr, H., & Ascheid, G. (1990). Synchronization in Digital Systems. Wiley. [DPLL 深入理论]
3. Rice, M. (2009). Digital Communications: A Discrete-Time Approach. Prentice Hall. [数据接收机中的 DPLL]
4. Staszewski, R. B., et al. (2005). “All-Digital PLL and Transmitter for Mobile Phones.” IEEE JSSC. [ADPLL/DCO 工业实现]

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相关页面

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