PLL 锁相捕获过程

PLL 从非锁定状态进入锁定状态的过程称为捕获（Acquisition）。相位捕获快但范围有限，频率捕获范围宽但速度慢。理解捕获行为对设计可靠的 PLL 至关重要。基于 Gardner Phaselock Techniques Ch.8 提炼。

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前后关系

前置知识：

• PLL基本结构与传递函数 — 锁定时跟踪行为
• PLL跟踪性能 — 锁定后的稳态/瞬态响应
• 非线性微分方程基本概念

本书内部链条：

• Ch.8（本文）← Ch.5（跟踪）— 跟踪是锁定后的行为，捕获是锁定前
• → PLL异常锁定现象（Ch.14）— 捕获过程中可能出现异常锁定

外部关联：

• PLL频率合成器 — 频率合成器的锁定时间规范
• Wireline系统中Jitter与CDR — CDR 的捕获过程

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原理介绍

1. 捕获的两个阶段

1. 频率捕获（Frequency Acquisition）：将 VCO 频率拉近到输入频率附近（频率差 < 环路带宽 K）
2. 相位捕获（Phase Acquisition）：消除剩余相位误差，进入锁定状态

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2. 相位捕获（Phase Acquisition）

一阶环相位捕获

特征方程（一阶环，Gardner (8.3)）：$d{\theta }_e/dt=\Delta \omega -K\sin {\theta }_e$

求解可得：

$${\theta }_e(t)=2{\tan }^{-1}\left[\frac{\Delta \omega }{K}+\frac{\sqrt{K^2-\Delta {\omega }^2}}{K}\tan \left(\frac{\sqrt{K^2-\Delta {\omega }^2}}{2}t+C\right)\right]$$

• 若 $|\Delta \omega |<K$：指数收敛到稳态值 ${\theta }_e(\infty )={\sin }^{-1}(\Delta \omega /K)$
• 若 $|\Delta \omega |\ge K$：无稳定锁定点，频率无法捕获

捕获时间：≈ 3/K（一阶环，Gardner §8.2.1；指数收敛时间常数 1/K，约 3 个时间常数达到锁定），与初始相位有关。

Hang-up 现象（Gardner §8.2.2）

当初始相位误差 ${\theta }_e(0)\approx \pi$ 时，一阶环的捕获时间可无限延长。

物理原因：$\sin {\theta }_e\approx 0$ 在 ${\theta }_e=\pi$ 附近 → 无有效误差信号驱动 VCO → 停滞。

缓解：使用 PFD（Ch.10）可以消除 hang-up，因为 PFD 在 ${\theta }_e=\pm 2\pi$ 处仍有有效输出。

Lock-in 过程（Gardner §8.2.3）

Lock-in 定义为无周滑的直接相位锁定：

• Lock-in 范围：$|\Delta {\omega }_L|=K$（(8.4)，二阶 Type 2）
• Lock-in 时间：${\tau }_L\approx 2\pi /{\omega }_n$

当初始频率差小于 K 时，PLL 可在约一个周期内直接相位锁定，不发生周滑。

辅助相位捕获（Gardner §8.2.4）

• 相位预置：通过已知初始相位差预先设置 VCO 控制电压
• 切换相位：使用辅助电路快速将相位误差拉入 lock-in 范围

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3. 频率捕获（Frequency Acquisition）

频率牵引（Frequency Pull-in）（Gardner §8.3.1）

当 $\Delta \omega >\Delta {\omega }_L$ 时，PLL 不能直接锁定，需经过频率牵引过程：

Pull-in 机制——拍频整流（Gardner §8.3.1）：频率差 $\Omega$ 产生的 beat note 经 PD 非线性整流出直流分量（(8.6)）：

$$v_p=K_d\left[\frac{\Omega }{K}-\sqrt{{\left(\frac{\Omega }{K}\right)}^2-1}\right]$$

该直流经环路滤波器积分 → 逐渐改变 VCO 平均频率 → 频率差减小 → 最终进入 lock-in 范围。

Pull-in 时间（二阶 type 2，Gardner (8.10)）：

$$T_p\approx \frac{4{\zeta }^2(\Delta \omega {)}^2}{K^3}$$

• $T_p\propto \Delta {\omega }^2$：频率差每增 10 倍，捕获时间增 100 倍！
• $T_p\propto 1/K^3$：增大环路增益可大幅缩短捕获时间

Pull-in 范围（Gardner (8.13)，受 $K_{DC}$ 限制）：

$$\Delta {\omega }_p\approx \sqrt{2K_{DC}\cdot K}$$

type 3 环（Gardner (8.14)）：$T_p\approx |\Delta \omega |{\tau }_2\sqrt{\pi }/K$，且可能出现振荡式捕获（在目标频率附近往返摆动后才锁定）。

频率扫描（Frequency Sweeping）（Gardner §8.3.2）

主动改变 VCO 控制电压以扫描 VCO 频率，直至进入 lock-in 范围。

方案：

1. 斜坡扫描：线性增加/减少 VCO 控制电压
2. 指数扫描：指数逼近目标频率
3. 周期扫描：三角波/sawtooth 反复扫描

扫描速率约束（Gardner (8.5)）：

$$\Delta f\lesssim B_L\cdot \delta$$

其中 $B_L$ 为环路噪声带宽、$\delta$ 为允许的频率步进相对量。过快的扫描速率导致环路过零时来不及响应 → 越过锁定点而不锁定。

Gardner 推荐扫频设计（(8.15)）：

$$\Lambda =\frac{{\omega }_n^2}{2}\left(1-\frac{2}{\sqrt{{\text{SNR}}_L}}\right)$$

配 ζ=0.7–1.0；噪声较大（SNRL 低）时应降低扫频速率。

鉴频器辅助捕获（Gardner §8.3.3）

使用频率鉴频器（FD）提供频率误差信号，与 PD 的输出叠加或切换。本质：鉴频辅助等效于在保持 ωn 不变的前提下增大 ζ 与 K（(8.17)），从而扩大 lock-in 范围、缩短捕获时间。

1. 鉴频器 + 鉴相器联合操作：

   • FD 在大频率差时主导 → 快速缩小频率差
   • PD 在小频率差时主导 → 相位锁定

2. 自动切换：

   • 提取频率误差 $\Delta f$ 的估计值
   • $\Delta f$ 大时启用 FD，小时关闭 FD

3. 噪声约束：SNRL < 6–10 dB 时鉴频信号被噪声淹没，慎用鉴频辅助。

频率鉴频器实现（Gardner §8.3.4）

• PFD 本身就是频率检测器：未锁定时其 DC 输出 ≈ Kd/2，方向指示频差符号（Ch.10 详述）
• Quadricorrelator（正交相关鉴频器）：I/Q 两路信号交叉相关，输出 ∝ 频差
• 旋转频率检测器（rotational frequency detector）：数字实现，适合高速接口
• 本质洞察：积分器上的电荷就是频率记忆——一切捕获辅助手段的物理本质都是给环路提供关于频差的持久记忆

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4. 锁定指示器（Lock Indicators）

作用

判断 PLL 是否处于锁定状态，用于：

• 初始化后续电路（如解调器开启）
• 系统状态监测
• 故障检测

实现方法

方法	原理	特点
PD 纹波监测	锁定后 PD 输出纹波最小	简单但阈值设置困难
正交辅助 PD	增加一个正交 PD，其输出 ∝ cosθe，锁定时达最大	Gardner 推荐方案，准确但需额外硬件
频率锁定检测	比较参考与 VCO 分频频率差	需计数器
数字锁定指示	检测相位误差是否长期保持在阈值内	软件/数字实现方便

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5. 大带宽方法（Gardner §8.4.2）

• 开始时使用大带宽（大 K）以快速捕获
• 锁定后切换到小带宽以获得优越的噪声性能
• 双带宽 PLL：设计两种环路滤波器时间常数，切换使用

6. 存储辅助（Memory）（Gardner §8.4.3）

• 在信号中断时保持 VCO 控制电压
• 使用模拟采样/保持或数字寄存器
• 减少重新捕获时间

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参考文献

1. Gardner, F. M. (2005). Phaselock Techniques (3rd ed.), Ch.8. John Wiley & Sons.
2. Meyr, H., & Ascheid, G. (1990). Synchronization in Digital Systems. Wiley. [数字 PLL 捕获分析]
3. Best, R. E. (2003). Phase-Locked Loops (5th ed.). McGraw-Hill. [PLL 捕获电路实现]
4. Wolaver, D. H. (1991). Phase-Locked Loop Circuit Design. Prentice Hall. [捕获参数经验公式]

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相关页面

• PLL基本结构与传递函数 — 锁定后行为
• PLL跟踪性能 — 锁定后跟踪
• 加性噪声对PLL影响 — 噪声影响捕获可靠性
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• PLL频率合成器 — 锁定时间规范
• PLL鉴相器 — PFD 的频率检测功能
• Gardner Phaselock Techniques 深度解析