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• Razavi Design of CMOS PLLs 深度解析

  Razavi Design of CMOS PLLs 深度解析 Design of CMOS Phase-Locked Loops (Cambridge, 2020) 是 Behzad Razavi 的 PLL 专著，从晶体管级电路设计到系统架构，系统覆盖 CMOS PLL 设计的全部核心主题。与 Gardner Phaselock Techniques 的系统/理论视角互补，本书侧重 CMOS 电路仿真驱动设计。 书籍定位 属性内容全称Design of CMOS Phase-Locked Loops: From Circuit Level to Architecture Level作者Be...

  • PLL
  • 振荡器
  • 相位噪声
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  • 频率合成
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• 时钟与数据恢复CDR原理

  时钟与数据恢复 CDR 原理 时钟与数据恢复（CDR）电路从随机二进制数据中提取时钟信息并重建同步时钟。CDR 是高速有线通信（SerDes、光通信）的核心模块。基于 Razavi Design of CMOS Phase-Locked Loops Ch.13-14 提炼。 前后关系 前置知识： PLL基本结构与传递函数 — CDR 本质是特殊 PLL PLL鉴相器 — CDR 中的 PD 设计与标准 PFD 不同 相位噪声对PLL影响 — CDR 的 jitter 传递/生成/容忍 外部关联： Wireline系统中Jitter与CDR — DaDalt/Gardner 对 CDR jitt...

  • CDR
  • 时钟恢复
  • 数据恢复
  • bang-bang-PD
  • Alexander-PD
  • Hogge-PD
  • 半速率
  • 频率捕获

• Wireline系统中Jitter与CDR

  Wireline 系统中的 Jitter 与 CDR 在高速串行链路中，jitter 是限制数据传输速率和距离的首要因素。CDR（时钟数据恢复）既要跟踪输入数据的 jitter，又要做 jitter 滤波产生干净的本地时钟，这体现为三大规范——Jitter Transfer、Jitter Generation、Jitter Tolerance——之间的根本折衷。 前后关系 前置知识： Jitter基本概念与定义 — period jitter, 眼图 Jitter统计分析与RJ-DJ分解 — total jitter, BER Jitter与Phase Noise关系 — jitter 频谱表...

  • Jitter
  • Wireline
  • CDR
  • Bang-bang-PD
  • 时钟恢复
  • 眼图
  • jitter-tolerance
  • 串行链路